Introduction to UVM
Corso
Online
Hai bisogno di un coach per la formazione?
Ti aiuterà a confrontare vari corsi e trovare l'offerta formativa più conveniente.
Il corso perfetto per imparare le direttive UVM!
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Tipologia
Corso
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Metodologia
Online
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Durata
4 Giorni
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Inizio
Scegli data
Il centro Leading Edge presenta sulla piattaforma Emagister.it il corso Introduction to UVM.
Il corso è un insieme coerente di lezioni e laboratori/esercizi. Le esperienze di laboratorio e i quiz dedicati sono pensati per rinforzare l’apprendimento della materia.
Tale corso è. quindi, indirizzato a quei progettisti che vogliono sviluppare i loro ambienti di verifica SystemVerilog seguendo le direttive UVM.
Il corso inizia da una struttura di test-bench UVM elementare e lo elabora per mostrare le tecniche per costruire dei test benches UVM potenti ed efficaci. Il corso è un insieme coerente di lezioni e laboratori/esercizi. Le esperienze di laboratorio e i quiz dedicati sono pensati per rinforzare l’apprendimento della materia.
Sedi e date
Luogo
Inizio del corso
Inizio del corso
Profilo del corso
Progettisti che hanno bisogno di sviluppare testbench utilizando la metodologia UVM
Conoscenza di System Verilog
attestato di partecipazione
Copre tutti gli aspetti di UVM necessari per creare testbench avanzate e ri-utlizzabile
Opinioni
Materie
- System Verilog
- UVM
- System Verilog Assertions
- Testbench
- Verilog
- Informatica e tecnologia
- Informatica
- Programmazione
- Programmazione C#
- C++
Professori
Nigel Woolaway
Ing.
Programma
- Introduction to UVM,
- Generating Reports and Messaging,
- Transaction Level Communication,
- Modelling Transactions,
- Basic Testbench Structure,
- Introduction tot he UVM Class Factory,
- Connecting to the DUT,
- Analysis,
- Hierarchy,
- Creating a Configurable Test Environment,
- Stimulus Generation,
- UVM Registers
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Introduction to UVM